典型文献
一种优化的MD5算法与硬件实现
文献摘要：
MD5算法是应用非常广泛的一种Hash算法,在数字签名和验签中占有重要地位,算法的效率会直接影响到签名和验签的速度.本文提出一种优化的MD5算法,采用三级加法器替代四级加法器、优化循环移位操作的方式缩短MD5算法单步运算的关键路径,并用VERILOG HDL语言进行硬件实现.通过仿真和FPGA验证,结果表明该设计功能正确,硬件资源消耗少,数据吞吐量大.该设计应用于一款密码安全芯片,采用0.18μm工艺进行MPW流片,芯片面积为6 mm2.时钟频率为150 MHz,电压3.3V时,功耗约为10.7 mW.
文献关键词：
MD5算法;hash算法;签名和验签;散列函数
中图分类号：
作者姓名：
王镇道;李妮
作者机构：
湖南大学物理与微电子科学学院 湖南长沙 410082
文献出处：
引用格式：
[1]王镇道;李妮-.一种优化的MD5算法与硬件实现)[J].湖南大学学报（自然科学版）,2022(02):106-110
A类：
VERILOG
B类：
MD5,硬件实现,Hash,数字签名,签名和验签,加法器,四级,循环移位,位操作,单步,关键路径,HDL,FPGA,设计功能,硬件资源,资源消耗,吞吐量,设计应用,密码安全,安全芯片,MPW,流片,mm2,时钟,MHz,3V,功耗,mW,hash,散列函数
AB值：
0.503955
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