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LDPC动态低延迟时分复用系统设计
文献摘要：
为解决远距离高速信号传输的数据校验问题,提高编译码算法的数据传输效率与纠错效率,设计了一种基于伽罗华域LDPC的时分复用系统.采用模块化思想和流水线思想设计电路架构,并在LDPC译码部分采用了增强型硬判决算法,使LDPC编解码模块的码率达到了0.8125,在FPGA平台上达到了400 MHz的工作频率,时分复用系统单次传输10240 bit数据时最快可达43.8μs.与其他文献成果相比,本系统在FPGA上实现较高的时钟频率,同时具有较高的码率和吞吐率,针对不同的数据位宽具有一定的通用性,可应用于长距离高速信号传输场合.
文献关键词：
时分复用;伽罗华域;低密度奇偶校验码;吞吐率;现场可编程门阵列;传输效率;码率
中图分类号：
作者姓名：
任建;于皓哲;辛晓宁;刘思源
作者机构：
沈阳工业大学 信息科学与工程学院,沈阳110870
文献出处：
引用格式：
[1]任建;于皓哲;辛晓宁;刘思源-.LDPC动态低延迟时分复用系统设计)[J].沈阳工业大学学报,2022(01):62-67
A类：
伽罗华域
B类：
LDPC,低延迟,时分复用,远距离,高速信号传输,数据校验,编译,译码算法,数据传输,传输效率,纠错,流水线,设计电路,电路架构,增强型,判决,决算法,编解码,码率,FPGA,上达,MHz,工作频率,bit,本系,时钟,吞吐率,数据位,通用性,长距离,低密度奇偶校验码,现场可编程门阵列
AB值：
0.369072
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