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FPGA的高精度DDS信号发生器设计
文献摘要：
出于对信号发生器性能、设计成本等方面的考虑,本文基于FPGA设计了精度高、稳定性强的DDS信号发生器.通过Verilog HDL语言对FPGA编程,构建DDS功能模块,实现基本数字频率合成功能.设计从三方面进行考量,即供电端电源调理电路、FPGA内部进行DDS杂散抑制以及输出端波形信号调理和滤波电路,尽可能抑制电路中噪声干扰和DDS信号调制产生的杂散问题.经过验证,该方案生成波形有效值误差为10 mV,纹波大小为10.20 mV,能实现高精度、高稳定性的信号发生器.
文献关键词：
DDS;杂散抑制;信号发生器;FPGA
中图分类号：
作者姓名：
黄浩然;文丰;贾兴中
作者机构：
中北大学仪器科学与动态测试教育部重点实验室,太原030051
文献出处：
引用格式：
[1]黄浩然;文丰;贾兴中-.FPGA的高精度DDS信号发生器设计)[J].单片机与嵌入式系统应用,2022(12):75-79
A类：
B类：
FPGA,DDS,信号发生器,设计成本,Verilog,HDL,功能模块,字频,频率合成,调理电路,杂散抑制,输出端,波形信号,信号调理,滤波电路,抑制电路,噪声干扰,信号调制,方案生成,有效值,mV,纹波,高稳定性
AB值：
0.397779
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