典型文献
动态重构硬件加速中的性能开销建模
文献摘要：
近年来,随着可重构计算方法和可重构硬件特性的不断演进,基于FPGA动态部分重构技术构建运行时可重构加速器已经成为解决传统加速器设计中硬件资源限制问题的重要途径.然而,区别于传统静态重构加速器,FPGA的动态重构开销是影响硬件加速整体性能的重要因素,而目前尚缺少能够在可重构硬件设计的早期阶段进行动态重构开销精确估算的相关方法.为此,通过对主流FPGA的比特流配置文件进行剖析,提出了一种基于可重构功能模块消耗的资源估算相应部分重构比特流文件大小的方法,并在此基础上构建了运行时重构的性能开销模型.作为验证,在Xilinx VC709 FPGA平台对神经网络计算方法如Winograd算法、FFT算法、GEMM算法和加密算法如AES、DES等进行了动态重构模式下的硬件部署.实验结果表明,所提出的性能开销模型可以对不同算法的动态重构开销进行快速评估,并达到了平均98％的准确率,能够便捷地应用于动态重构加速器设计中.
文献关键词：
动态重构;代价模型;现场可编程门阵列(FPGA);硬件加速
中图分类号：
作者姓名：
苑福利;宫磊;娄文启;陈香兰
作者机构：
中国科学技术大学 计算机科学与技术学院,合肥 230027
文献出处：
引用格式：
[1]苑福利;宫磊;娄文启;陈香兰-.动态重构硬件加速中的性能开销建模)[J].计算机工程与应用,2022(06):69-79
A类：
VC709
B类：
动态重构,硬件加速,能开,开销,可重构计算,FPGA,部分重构,重构技术,技术构建,加速器设计,硬件资源,资源限制,静态重构,整体性能,尚缺,硬件设计,早期阶段,相关方法,比特流,流配,配置文件,功能模块,文件大小,Xilinx,Winograd,FFT,GEMM,加密算法,AES,DES,重构模式,硬件部署,快速评估,代价模型,现场可编程门阵列
AB值：
0.396597
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