典型文献
高性能超低延迟BCH译码器电路结构设计
文献摘要：
针对BCH译码算法纠错性能的局限性和译码算法中查找表规模较大的问题,以及处理器对可靠性和低译码延迟的设计需求,本文设计了BCH码和循环冗余校验码的级联纠错编码方案的数据结构.采用避免求逆的Ber-lekamp-Massey译码算法,结合有限域元素运算方法,优化了错误位置搜索过程,给出了面向超大规模集成电路的低延迟译码器结构.以实时计算元素系数的方式代替了查找表,缩减了电路的面积.采用65 nm工艺完成了译码器的超大规模集成电路设计,译码器具有随机9位的纠错能力,电路面积为436333μm2,在200 MHz工作频率下译码延迟仅为2.795μs,译码器的数据吞吐率可以达到191 MB/s.在保持译码性能的同时,达到了低译码延迟、低功耗的设计需求.
文献关键词：
BCH译码;超大规模集成电路;超低延迟;查找表;矩阵求逆;错误位置搜索;简氏搜索解法;高吞吐量
中图分类号：
作者姓名：
杨宇恒;刘海洋;李金海;原青;刘建
作者机构：
中国科学院微电子研究所,北京 100029
文献出处：
引用格式：
[1]杨宇恒;刘海洋;李金海;原青;刘建-.高性能超低延迟BCH译码器电路结构设计)[J].哈尔滨工程大学学报,2022(08):1192-1198
A类：
lekamp,错误位置搜索,简氏搜索解法
B类：
超低延迟,BCH,译码器,电路结构,译码算法,查找表,规模较,处理器,设计需求,循环冗余校验码,纠错编码,编码方案,数据结构,Ber,Massey,有限域,超大规模集成电路,实时计算,集成电路设计,纠错能力,MHz,工作频率,吞吐率,MB,译码性能,低功耗,矩阵求逆,高吞吐量
AB值：
0.250254
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